[AC2] Aula03 Addicionals
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74408b634d
commit
ec81a6b4d9
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@ -0,0 +1,27 @@
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.equ ADDR_BASE, 0xBF88
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.equ TRISB, 0x6040
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.equ PORTB, 0x6050
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.equ TRISE, 0x6100
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.equ LATE, 0x6120
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.data
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.text
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.globl main
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main:
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lui $t7, ADDR_BASE
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lw $t0, TRISE($t7)
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andi $t0, $t0, 0xFFC3
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sw $t0, TRISE($t7)
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lw $t0, TRISB($t7)
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ori $t0, $t0, 0x000F
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sw $t0, TRISB($t7)
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loop:
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lw $t0, PORTB($t7)
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sll $t0, $t0, 2
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sw $t0, LATE($t7)
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j loop
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@ -0,0 +1,62 @@
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.equ ADDR_BASE, 0xBF88
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.equ TRISE, 0x6100
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.equ LATE, 0x6120
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.equ TRISD, 0x60C0
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.equ LATD, 0x60E0
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.equ READ_CORE_TIMER, 11
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.equ RESET_CORE_TIMER, 12
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.data
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.text
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.globl main
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main:
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lui $t7, ADDR_BASE
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lw $t0, TRISE($t7)
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andi $t0, $t0, 0xFFFE
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sw $t0, TRISE($t7)
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lw $t0, TRISD($t7)
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andi $t0, $t0, 0xFFFE
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sw $t0, TRISD($t7)
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li $t0, 0x0000
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loop:
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lw $t1, LATE($t7)
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andi $t1, $t1, 0xFFFE
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or $t1, $t1, $t0
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sw $t1, LATE($t7)
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lw $t1, LATD($t7)
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andi $t1, $t1, 0xFFFE
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or $t1, $t1, $t0
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sw $t1, LATD($t7)
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addi $sp, $sp, -8
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sw $ra, 0($sp)
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sw $t0, 4($sp)
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li $a0, 500
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jal delay
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lw $ra, 0($sp)
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lw $t0, 4($sp)
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addi $sp, $sp, 8
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xori $t0, $t0, 0x0001
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j loop
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# ----------- DELAY FUNCTION ------------
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delay: li $v0, RESET_CORE_TIMER
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syscall
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wait: li $v0, READ_CORE_TIMER
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syscall
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mul $t0, $a0, 20000
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blt $v0, $t0, wait
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jr $ra
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@ -20,7 +20,7 @@ main:
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andi $t0, $t0, 0xFFE1 # 1111 1111 1110 0001 (isola bits 4-1)
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andi $t0, $t0, 0xFFE1 # 1111 1111 1110 0001 (isola bits 4-1)
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sw $t0, TRISE($t7) # Configura RE4-RE1 como output
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sw $t0, TRISE($t7) # Configura RE4-RE1 como output
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li $t0, 0x0010 # Iniciar contagem
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li $t0, 0x0000 # Iniciar contagem
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loop:
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loop:
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lw $t1, LATE($t7)
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lw $t1, LATE($t7)
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