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TiagoRG 2630762c1f [LSD] pratica04 CounterDemo enable/disable added and added FreqDevider by itself		2023-04-04 22:06:30 +01:00
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master.qsf	[LSD] Recreated master.qsf at lsd root	2023-03-07 23:00:18 +00:00

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Laboratórios de Sistemas Digitais

Projetos, exercícios e material organizados por aulas

Índice

Aula nº	Tópicos
01	Introdução às FPGAs
02	Modelação em VHDL, simulação e implementação de componentes combinatórios
03	Modelação em VHDL e implementação de circuitos aritméticos
04	Modelação em VHDL, simulação e implementação de circuitos sequenciais elementares
05	Parametrização de componentes
06	Modelação em VHDL e implementação de registos e módulos combinatórios de deslocamento
07	Construção e utilização de testbenches em VHDL Simulação comportamental e temporal Depuração de circuitos em FPGA
10	Modelação em VHDL de Memórias ROM e RAM de um Porto e Multi-porto

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