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// Copyright (C) 2020 Intel Corporation. All rights reserved.
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// Your use of Intel Corporation's design tools, logic functions
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// and other software and tools, and any partner logic
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// functions, and any output files from any of the foregoing
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// (including device programming or simulation files), and any
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// associated documentation or information are expressly subject
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// to the terms and conditions of the Intel Program License
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// Subscription Agreement, the Intel Quartus Prime License Agreement,
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// the Intel FPGA IP License Agreement, or other applicable license
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// agreement, including, without limitation, that your use is for
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// the sole purpose of programming logic devices manufactured by
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// Intel and sold by Intel or its authorized distributors. Please
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// refer to the applicable agreement for further details, at
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// https://fpgasoftware.intel.com/eula.
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// *****************************************************************************
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// This file contains a Verilog test bench with test vectors .The test vectors
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// are exported from a vector file in the Quartus Waveform Editor and apply to
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// the top level entity of the current Quartus project .The user can use this
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// testbench to simulate his design using a third-party simulation tool .
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// *****************************************************************************
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// Generated on "11/18/2022 13:03:39"
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// Verilog Test Bench (with test vectors) for design : Mux16_1
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//
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// Simulation tool : 3rd Party
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//
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`timescale 1 ps/ 1 ps
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module Mux16_1_vlg_vec_tst();
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// constants
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// general purpose registers
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reg I0;
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reg I1;
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reg I2;
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reg I3;
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reg I4;
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reg I5;
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reg I6;
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reg I7;
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reg I8;
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reg I9;
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reg I10;
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reg I11;
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reg I12;
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reg I13;
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reg I14;
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reg I15;
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reg Sel1;
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reg Sel2;
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reg Sel3;
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reg Sel4;
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// wires
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wire pin_name1;
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// assign statements (if any)
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Mux16_1 i1 (
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// port map - connection between master ports and signals/registers
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.I0(I0),
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.I1(I1),
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.I2(I2),
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.I3(I3),
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.I4(I4),
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.I5(I5),
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.I6(I6),
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.I7(I7),
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.I8(I8),
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.I9(I9),
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.I10(I10),
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.I11(I11),
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.I12(I12),
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.I13(I13),
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.I14(I14),
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.I15(I15),
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.pin_name1(pin_name1),
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.Sel1(Sel1),
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.Sel2(Sel2),
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|
.Sel3(Sel3),
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.Sel4(Sel4)
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);
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initial
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begin
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#1000000 $finish;
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end
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// I0
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initial
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begin
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I0 = 1'b1;
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I0 = #5000 1'b0;
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I0 = #5000 1'b1;
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I0 = #5000 1'b0;
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I0 = #20000 1'b1;
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I0 = #5000 1'b0;
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|
I0 = #5000 1'b1;
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|
I0 = #5000 1'b0;
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|
I0 = #20000 1'b1;
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I0 = #5000 1'b0;
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I0 = #10000 1'b1;
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I0 = #25000 1'b0;
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|
I0 = #40000 1'b1;
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I0 = #10000 1'b0;
|
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I0 = #20000 1'b1;
|
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|
I0 = #15000 1'b0;
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I0 = #10000 1'b1;
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I0 = #5000 1'b0;
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I0 = #5000 1'b1;
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I0 = #15000 1'b0;
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I0 = #5000 1'b1;
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|
I0 = #20000 1'b0;
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I0 = #5000 1'b1;
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I0 = #5000 1'b0;
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I0 = #25000 1'b1;
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I0 = #5000 1'b0;
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|
I0 = #25000 1'b1;
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I0 = #10000 1'b0;
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I0 = #5000 1'b1;
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I0 = #5000 1'b0;
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|
I0 = #35000 1'b1;
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I0 = #10000 1'b0;
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I0 = #5000 1'b1;
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I0 = #5000 1'b0;
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I0 = #5000 1'b1;
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I0 = #5000 1'b0;
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|
I0 = #35000 1'b1;
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I0 = #5000 1'b0;
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I0 = #5000 1'b1;
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I0 = #10000 1'b0;
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|
I0 = #20000 1'b1;
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I0 = #5000 1'b0;
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I0 = #10000 1'b1;
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I0 = #15000 1'b0;
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I0 = #20000 1'b1;
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I0 = #5000 1'b0;
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I0 = #10000 1'b1;
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I0 = #5000 1'b0;
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I0 = #10000 1'b1;
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I0 = #5000 1'b0;
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I0 = #15000 1'b1;
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I0 = #10000 1'b0;
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I0 = #5000 1'b1;
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I0 = #5000 1'b0;
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|
I0 = #5000 1'b1;
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|
I0 = #30000 1'b0;
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|
I0 = #5000 1'b1;
|
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I0 = #5000 1'b0;
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I0 = #5000 1'b1;
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|
I0 = #10000 1'b0;
|
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|
I0 = #5000 1'b1;
|
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|
I0 = #20000 1'b0;
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I0 = #5000 1'b1;
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I0 = #5000 1'b0;
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I0 = #5000 1'b1;
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|
I0 = #5000 1'b0;
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|
I0 = #10000 1'b1;
|
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I0 = #10000 1'b0;
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I0 = #5000 1'b1;
|
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|
I0 = #5000 1'b0;
|
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|
I0 = #10000 1'b1;
|
||
|
I0 = #30000 1'b0;
|
||
|
I0 = #10000 1'b1;
|
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|
I0 = #5000 1'b0;
|
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|
I0 = #15000 1'b1;
|
||
|
I0 = #10000 1'b0;
|
||
|
I0 = #5000 1'b1;
|
||
|
I0 = #10000 1'b0;
|
||
|
I0 = #10000 1'b1;
|
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|
I0 = #15000 1'b0;
|
||
|
I0 = #15000 1'b1;
|
||
|
I0 = #10000 1'b0;
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|
I0 = #5000 1'b1;
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|
I0 = #10000 1'b0;
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||
|
I0 = #5000 1'b1;
|
||
|
I0 = #15000 1'b0;
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|
I0 = #10000 1'b1;
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|
I0 = #15000 1'b0;
|
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|
I0 = #10000 1'b1;
|
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|
I0 = #5000 1'b0;
|
||
|
I0 = #20000 1'b1;
|
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I0 = #20000 1'b0;
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end
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// I1
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initial
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begin
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I1 = 1'b1;
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I1 = #20000 1'b0;
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I1 = #10000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
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|
I1 = #5000 1'b1;
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||
|
I1 = #10000 1'b0;
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||
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I1 = #5000 1'b1;
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I1 = #10000 1'b0;
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|
I1 = #10000 1'b1;
|
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|
I1 = #10000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #10000 1'b0;
|
||
|
I1 = #15000 1'b1;
|
||
|
I1 = #10000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #15000 1'b0;
|
||
|
I1 = #10000 1'b1;
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|
I1 = #10000 1'b0;
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|
I1 = #5000 1'b1;
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I1 = #5000 1'b0;
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||
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I1 = #5000 1'b1;
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||
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I1 = #10000 1'b0;
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||
|
I1 = #5000 1'b1;
|
||
|
I1 = #15000 1'b0;
|
||
|
I1 = #10000 1'b1;
|
||
|
I1 = #10000 1'b0;
|
||
|
I1 = #10000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #20000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
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|
I1 = #15000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
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|
I1 = #10000 1'b0;
|
||
|
I1 = #20000 1'b1;
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|
I1 = #10000 1'b0;
|
||
|
I1 = #15000 1'b1;
|
||
|
I1 = #5000 1'b0;
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|
I1 = #5000 1'b1;
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|
I1 = #10000 1'b0;
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|
I1 = #5000 1'b1;
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I1 = #10000 1'b0;
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|
I1 = #5000 1'b1;
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|
I1 = #10000 1'b0;
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|
I1 = #5000 1'b1;
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|
I1 = #10000 1'b0;
|
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I1 = #15000 1'b1;
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||
|
I1 = #5000 1'b0;
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I1 = #10000 1'b1;
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I1 = #25000 1'b0;
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I1 = #5000 1'b1;
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I1 = #10000 1'b0;
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I1 = #5000 1'b1;
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I1 = #5000 1'b0;
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I1 = #20000 1'b1;
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I1 = #15000 1'b0;
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I1 = #10000 1'b1;
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I1 = #5000 1'b0;
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I1 = #5000 1'b1;
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I1 = #10000 1'b0;
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I1 = #5000 1'b1;
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I1 = #10000 1'b0;
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I1 = #5000 1'b1;
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I1 = #10000 1'b0;
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||
|
I1 = #15000 1'b1;
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||
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I1 = #25000 1'b0;
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||
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I1 = #35000 1'b1;
|
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|
I1 = #15000 1'b0;
|
||
|
I1 = #10000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #10000 1'b1;
|
||
|
I1 = #15000 1'b0;
|
||
|
I1 = #5000 1'b1;
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||
|
I1 = #10000 1'b0;
|
||
|
I1 = #10000 1'b1;
|
||
|
I1 = #20000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #10000 1'b0;
|
||
|
I1 = #20000 1'b1;
|
||
|
I1 = #20000 1'b0;
|
||
|
I1 = #10000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #10000 1'b0;
|
||
|
I1 = #15000 1'b1;
|
||
|
I1 = #10000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #15000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #15000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
I1 = #5000 1'b1;
|
||
|
I1 = #5000 1'b0;
|
||
|
end
|
||
|
|
||
|
// I2
|
||
|
initial
|
||
|
begin
|
||
|
I2 = 1'b0;
|
||
|
I2 = #5000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
||
|
I2 = #10000 1'b1;
|
||
|
I2 = #10000 1'b0;
|
||
|
I2 = #20000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
||
|
I2 = #15000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
||
|
I2 = #5000 1'b1;
|
||
|
I2 = #10000 1'b0;
|
||
|
I2 = #20000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
||
|
I2 = #10000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
||
|
I2 = #10000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
||
|
I2 = #5000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
||
|
I2 = #25000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
||
|
I2 = #5000 1'b1;
|
||
|
I2 = #10000 1'b0;
|
||
|
I2 = #15000 1'b1;
|
||
|
I2 = #10000 1'b0;
|
||
|
I2 = #5000 1'b1;
|
||
|
I2 = #10000 1'b0;
|
||
|
I2 = #10000 1'b1;
|
||
|
I2 = #25000 1'b0;
|
||
|
I2 = #20000 1'b1;
|
||
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I2 = #35000 1'b0;
|
||
|
I2 = #10000 1'b1;
|
||
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I2 = #10000 1'b0;
|
||
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I2 = #5000 1'b1;
|
||
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I2 = #10000 1'b0;
|
||
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I2 = #40000 1'b1;
|
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I2 = #10000 1'b0;
|
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I2 = #5000 1'b1;
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I2 = #5000 1'b0;
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I2 = #15000 1'b1;
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I2 = #5000 1'b0;
|
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I2 = #5000 1'b1;
|
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I2 = #5000 1'b0;
|
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I2 = #15000 1'b1;
|
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I2 = #10000 1'b0;
|
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I2 = #5000 1'b1;
|
||
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I2 = #5000 1'b0;
|
||
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I2 = #20000 1'b1;
|
||
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I2 = #5000 1'b0;
|
||
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I2 = #5000 1'b1;
|
||
|
I2 = #5000 1'b0;
|
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I2 = #5000 1'b1;
|
||
|
I2 = #15000 1'b0;
|
||
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I2 = #15000 1'b1;
|
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I2 = #5000 1'b0;
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
end
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// I8
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|
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|
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|
||
|
I8 = #5000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #5000 1'b0;
|
||
|
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|
||
|
I8 = #5000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #5000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
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|
I8 = #5000 1'b1;
|
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|
I8 = #20000 1'b0;
|
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|
I8 = #15000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #5000 1'b0;
|
||
|
I8 = #20000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #15000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
||
|
I8 = #15000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
||
|
I8 = #15000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
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|
||
|
I8 = #5000 1'b1;
|
||
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
I8 = #10000 1'b1;
|
||
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I8 = #5000 1'b1;
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|
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|
||
|
I8 = #5000 1'b1;
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|
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|
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|
I8 = #5000 1'b1;
|
||
|
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|
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|
I8 = #5000 1'b0;
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|
I8 = #15000 1'b1;
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|
I8 = #25000 1'b0;
|
||
|
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|
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|
||
|
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|
||
|
I8 = #5000 1'b1;
|
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|
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|
||
|
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|
||
|
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|
||
|
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|
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|
I8 = #15000 1'b0;
|
||
|
I8 = #10000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #20000 1'b0;
|
||
|
I8 = #20000 1'b1;
|
||
|
I8 = #10000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
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|
I8 = #10000 1'b0;
|
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|
I8 = #15000 1'b1;
|
||
|
I8 = #5000 1'b0;
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|
I8 = #10000 1'b1;
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|
I8 = #15000 1'b0;
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I8 = #5000 1'b1;
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I8 = #10000 1'b0;
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I8 = #5000 1'b1;
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I8 = #5000 1'b0;
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I8 = #20000 1'b1;
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|
I8 = #15000 1'b0;
|
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|
I8 = #5000 1'b1;
|
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|
I8 = #5000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #20000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #5000 1'b0;
|
||
|
I8 = #15000 1'b1;
|
||
|
I8 = #5000 1'b0;
|
||
|
I8 = #25000 1'b1;
|
||
|
I8 = #5000 1'b0;
|
||
|
I8 = #5000 1'b1;
|
||
|
I8 = #5000 1'b0;
|
||
|
I8 = #15000 1'b1;
|
||
|
end
|
||
|
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I11 = #5000 1'b0;
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// I14
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|
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|
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I14 = #5000 1'b1;
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I14 = #15000 1'b0;
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I14 = #10000 1'b1;
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I14 = #10000 1'b0;
|
||
|
I14 = #5000 1'b1;
|
||
|
I14 = #5000 1'b0;
|
||
|
I14 = #15000 1'b1;
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|
I14 = #5000 1'b0;
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||
|
end
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// I15
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initial
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begin
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I15 = 1'b0;
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I15 = #15000 1'b1;
|
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|
I15 = #10000 1'b0;
|
||
|
I15 = #5000 1'b1;
|
||
|
I15 = #5000 1'b0;
|
||
|
I15 = #5000 1'b1;
|
||
|
I15 = #5000 1'b0;
|
||
|
I15 = #5000 1'b1;
|
||
|
I15 = #15000 1'b0;
|
||
|
I15 = #15000 1'b1;
|
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|
I15 = #5000 1'b0;
|
||
|
I15 = #5000 1'b1;
|
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|
I15 = #10000 1'b0;
|
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|
I15 = #10000 1'b1;
|
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|
I15 = #20000 1'b0;
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|
I15 = #5000 1'b1;
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|
I15 = #5000 1'b0;
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I15 = #10000 1'b1;
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I15 = #10000 1'b0;
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I15 = #5000 1'b1;
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I15 = #30000 1'b0;
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I15 = #15000 1'b1;
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I15 = #10000 1'b0;
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I15 = #25000 1'b1;
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I15 = #5000 1'b0;
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I15 = #5000 1'b1;
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I15 = #10000 1'b0;
|
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|
I15 = #15000 1'b1;
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|
I15 = #15000 1'b0;
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|
I15 = #15000 1'b1;
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|
I15 = #15000 1'b0;
|
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|
I15 = #5000 1'b1;
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|
I15 = #10000 1'b0;
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|
I15 = #15000 1'b1;
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I15 = #5000 1'b0;
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I15 = #5000 1'b1;
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|
I15 = #20000 1'b0;
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|
I15 = #5000 1'b1;
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|
I15 = #20000 1'b0;
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|
I15 = #5000 1'b1;
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|
I15 = #10000 1'b0;
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|
I15 = #5000 1'b1;
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|
I15 = #5000 1'b0;
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I15 = #10000 1'b1;
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I15 = #5000 1'b0;
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|
I15 = #15000 1'b1;
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I15 = #5000 1'b0;
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I15 = #5000 1'b1;
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I15 = #15000 1'b0;
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I15 = #5000 1'b1;
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I15 = #15000 1'b0;
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I15 = #5000 1'b1;
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I15 = #15000 1'b0;
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I15 = #10000 1'b1;
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I15 = #50000 1'b0;
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I15 = #10000 1'b1;
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I15 = #10000 1'b0;
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I15 = #5000 1'b1;
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I15 = #10000 1'b0;
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I15 = #5000 1'b1;
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I15 = #15000 1'b0;
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I15 = #10000 1'b1;
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I15 = #5000 1'b0;
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I15 = #5000 1'b1;
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||
|
I15 = #10000 1'b0;
|
||
|
I15 = #20000 1'b1;
|
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|
I15 = #5000 1'b0;
|
||
|
I15 = #10000 1'b1;
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|
I15 = #5000 1'b0;
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||
|
I15 = #5000 1'b1;
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I15 = #5000 1'b0;
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|
I15 = #5000 1'b1;
|
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|
I15 = #15000 1'b0;
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|
I15 = #10000 1'b1;
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|
I15 = #5000 1'b0;
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|
I15 = #10000 1'b1;
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I15 = #20000 1'b0;
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|
I15 = #5000 1'b1;
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I15 = #15000 1'b0;
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I15 = #15000 1'b1;
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|
I15 = #10000 1'b0;
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I15 = #10000 1'b1;
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I15 = #5000 1'b0;
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I15 = #5000 1'b1;
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I15 = #10000 1'b0;
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I15 = #5000 1'b1;
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I15 = #5000 1'b0;
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I15 = #15000 1'b1;
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I15 = #5000 1'b0;
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I15 = #5000 1'b1;
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I15 = #15000 1'b0;
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I15 = #15000 1'b1;
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I15 = #20000 1'b0;
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I15 = #20000 1'b1;
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end
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// Sel1
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initial
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begin
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Sel1 = 1'b0;
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end
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// Sel2
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initial
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begin
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Sel2 = 1'b0;
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end
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// Sel3
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initial
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begin
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Sel3 = 1'b0;
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end
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// Sel4
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initial
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|
begin
|
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|
Sel4 = 1'b0;
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end
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endmodule
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